То что вы предложили чуть выше - SpiClk = DFF(!SpiClk, DFF(DivOut, Clk, ,), Это насколько я понял на двух D триггерах. D.... («Телесистемы»: Конференция «Микроконтроллеры и их применение»)

Разработка, производство и продажа радиоэлектронной аппаратуры

| Карта сайта | Пишите нам | В избранное

Требуется программист в Зеленограде
- обработка данных с датчиков; ColdFire; 40 тыс.
e-mail:jobsmp@pochta.ru

Телесистемы | Электроника | Конференция «Микроконтроллеры и их применение»

То что вы предложили чуть выше - SpiClk = DFF(!SpiClk, DFF(DivOut, Clk, ,), Это насколько я понял на двух D триггерах. D триггер тот что в скобках на D вход подается DivOut и на C вход clock В результате имеем на Q выходе или C входе второго D триггера 1 синхронно с Clock. Согласен R вход тут не причем. Просто есть еще вариант на D вход разрешение 0 или 1, на C - Clock и C Q выхода на R вход этого же триггера обратная связь. (+)

Отправлено Make_Pic 15 сентября 2009, г. 21:17
В ответ на: Ничего не понял. То, что я написал, я моделил - работает. отправлено пользователем Леонид Иванович 15 сентября 2009, г. 20:26

Получаем, когда есть 1 разрешение на D воходе на Q имеем короткие импульсы Clock.

Составить ответ | Вернуться на конференцию.

Ответы

Это будут очень короткие импульсы, длительность которых определяется задержкой триггера. Не следует использовать такие сигналы. - Леонид Иванович (15.09.2009, 21:40:57 87.252.227.56, пустое)
- Да, но в обратную связь можно поставить цепочку логики, или опять же D триггер для задержки на такт (clock) - Make_Pic (15.09.2009, 22:08:13 90.150.216.139, пустое)
  - Цепочка логики - это не наш метод :) А D-триггер лучше сразу задействовать для привязки к clk, что и было сделано. - Леонид Иванович (15.09.2009, 22:26:5 87.252.227.56, пустое)