[an error occurred while processing this directive]
|
берешь компонентик DDS из CoreGen Xilinx, реализует практически любую разрядность приращения фазы аккумулятора, глубину и ширину таблицы синуса (из доступных ресурсов FPGA), так вот с 28-ми разрядным приращениме фазы и 14-ти разрядным квадратурным выходом на Virtex-E-7 112МГц вытянет, на Virtex-2 и 150МГц без проблем.
Не хочется black box - так тоже самое можно написать и вручную, но с помощью CoreGen - дело буквально пяти минут.
Удачи
E-mail: info@telesys.ru