[an error occurred while processing this directive]
|
Проблема в следующем.
Режим конфигурирования slave-serial, т.е. выводы M0, M1, M2 подключенны к +3.3V. При этом вывод конфигурационного клока CCLK должен быть входом. Но на самом деле вижу на этом выводе клоки частотой около 3 МГц. Т.е. каким-то образом м/c "встает" в режим master (вывод CCLK сейчас ни к чему не подключен).
Ничего не могу понять.
Сначала грешил на непропай выводов M0, M1, M2, но в datasheet вычитал буквально следующее "Выводы M2, M1, M0 имеют внутренние резисторы pull-up, и по умолчанию они подключены к логической 1, если оставлены неподсоединёнными".
Могут ли влиять ножки периферийного сканирования TMS, TDI, TCK на CCLK?
Может у кого-нить есть мысли?
E-mail: info@telesys.ru