Отправлено V61 11 февраля 2004 г. 19:06 В ответ на: должно быть 8*126=1008 slice - видимо с упаковкой что-то плохо отправлено yes 11 февраля 2004 г. 18:52

architecture DELAY of DELAY is
type mem is array (0 to 15) of STD_LOGIC_VECTOR (data_range - 1 downto 0);
signal sm0 : STD_LOGIC_VECTOR(data_range - 1 downto 0);
signal reg : mem;
begin
process(clk)
begin
if clk = '1' and clk'event then
if ce = '1' then
reg <= d_in & reg(0 to 14);
end if;
end if;
end process;

process(clk,rst)
begin
if rst = '1' then
sm0 <= (others => '0');
elsif clk = '1' and clk'event then
if ce = '1' then
sm0 <= sm0 + reg(conv_integer(A));
end if;
end if;
end process;
d_out <= sm0;

Нет проблем. Для 16 разрядов:
Number of Slices: 16 out of 768 2%
Number of Slice Flip Flops: 16 out of 1,536 1%
Total Number 4 input LUTs: 32 out of 1,536 2%
Number used as LUTs: 16
Number used as Shift registers: 16

• вобщем понятно, я думаю, что если оставить только фильтр - то результат синтеза будет — yes   (12.02.2004 09:32, 315 байт)
  • Да, в XC3S только 50% Lut можно использовать как RAM(SRL). — V61   (12.02.2004 11:30, 148 байт)
    • да, то что SM для Циклона предложил — yes   (12.02.2004 11:44, пустое)
      • Поставить BRAM место 4(8) Slice? — V61   (12.02.2004 12:24, 104 байт)